Xilinx ISE如何查看内部模块连线的波形

 时间:2024-10-15 08:56:28

1、首先先说一种比士嫣轶嗄较笨拙的方法,但是用自动代码生成工具,也会非常方便。就是把要调试的变量筛选出来,在顶层模块自动生成用于调试的output输出以及添加用于调试的wire变量。

Xilinx ISE如何查看内部模块连线的波形
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2、在Test测试文件中不需要自行编写连线,只需要新建Test Fixture,ISE会自动生成调试连线。

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3、但是如果我们不满足于顶层模块的输出,在左边选择Instances and Process,展开我们的测试模块,层层展开可以看到所有的子模块。

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4、在一个子模块上右键,点击Add To Wave Window,或者通过快捷键Ctr盟敢势袂l+W,就可以将这个次级模块的输入,输出,和常量添加到波形窗。

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5、添加完以后,点击重新开始,接着设置步进时间,然后就可以点击步进查看波形了。

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6、在波形窗口上,可以根据不同的标志区分输入I,输出O,常量C。

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7、在选定的波形上,可以在右键菜单中的Redix调整波形显示进制。注意,如果是数组需要展开设置数组里边。

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8、通过移动时间黄线,对比常量Parameter,可以迅速确定一个信号波形是哪个Parameter。

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